Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

A sample-time error calibration technique in time-interleaved ADCs with correlation-based detection and voltage-controlled compensation., , , , und . APCCAS, Seite 128-131. IEEE, (2012)A DLL based low-phase-noise clock multiplier with offset-tolerant PFD., , und . ASICON, Seite 1-4. IEEE, (2013)A background time-skew calibration technique in flash-assisted time-interleaved SAR ADCs., , , , und . ASICON, Seite 295-298. IEEE, (2017)A 13-bit non-binary weighted SAR ADC with bridge structure using digital calibration for capacitor weight error., , und . ASICON, Seite 32-35. IEEE, (2017)A dual-mode VCO based low-power synthesizer with optimized automatic frequency calibration for software-defined radio., , , , , und . ISCAS, Seite 1145-1148. IEEE, (2011)Automatic gain control algorithm with high-speed and double closed-loop in UWB system., , , , und . ASICON, Seite 1-4. IEEE, (2013)A 7.8 fJ/conversion-step 9-bit 400-MS/s single-channel SAR ADC with fast control logic., , , und . APCCAS, Seite 42-45. IEEE, (2018)A 4.5-W, 18.5-24.5-GHz GaN Power Amplifier Employing Chebyshev Matching Technique., , , , und . IEEE Trans. Very Large Scale Integr. Syst., 31 (2): 233-242 (Februar 2023)Seven-bit 700-MS/s Four-Way Time-Interleaved SAR ADC With Partial $V_cm$ -Based Switching., , , , , , , und . IEEE Trans. Very Large Scale Integr. Syst., 25 (3): 1168-1172 (2017)A Monolithic Sub-sampling PLL based 6-18 GHz Frequency Synthesizer for C, X, Ku Band Communication., , , , , und . IEICE Trans. Electron., 98-C (1): 16-27 (2015)