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Functional test environment for time-triggered control systems in complex MPSoCs., , , , und . Microprocess. Microsystems, (2020)A Hypervisor Architecture for Low-Power Real-Time Embedded Systems., , , , , , und . DSD, Seite 252-259. IEEE Computer Society, (2018)SAFEPOWER project: Architecture for safe and power-efficient mixed-criticality systems., , , , , , , , , und 8 andere Autor(en). Microprocess. Microsystems, (2017)Probabilistic State-Based RT-Analysis of SDFGs on MPSoCs with Shared Memory Communication., , , , und . DATE, Seite 1715-1720. IEEE, (2019)SAFEPOWER: Application of Power Management Techniques in SoCs for Safety-Relevant Systems., , , , und . COINS, Seite 104-109. ACM, (2019)Experimental Evaluation of Scenario Aware Synchronous Data Flow based Power Management., , , , und . COINS, Seite 80-85. ACM, (2019)A Design-flow for implementing, validating and evaluating Machine-learning Classifiers on FPGAs., und . COINS, Seite 86-91. ACM, (2019)Towards power management verification of time-triggered systems using virtual platforms., , , , und . SAMOS, Seite 81-88. ACM, (2018)Capturing Neural-Networks as Synchronous Dataflow Graphs., , und . MBMV, Seite 1-10. VDE / IEEE, (2020)