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Prediction Based DRAM Row-Buffer Management in the Many-Core Era., , , und . PACT, Seite 183-184. IEEE Computer Society, (2011)Handling the problems and opportunities posed by multiple on-chip memory controllers., , , , und . PACT, Seite 319-330. ACM, (2010)Parsimony: Enabling SIMD/Vector Programming in Standard Compiler Flows., , , , und . CGO, Seite 186-198. ACM, (2023)Architectural Support for Optimizing Huge Page Selection Within the OS., , , , , und . MICRO, Seite 1213-1226. ACM, (2023)The Architectural Implications of Distributed Reinforcement Learning on CPU-GPU Systems., , , , , , und . CoRR, (2020)Improving Operating System and Hardware Interactions Through Co-Design.. University of Utah, USA, (2014)FinePack: Transparently Improving the Efficiency of Fine-Grained Transfers in Multi-GPU Systems., , , , und . HPCA, Seite 516-529. IEEE, (2023)Micro-pages: increasing DRAM efficiency with locality-aware data placement., , , , , und . ASPLOS, Seite 219-230. ACM, (2010)Hardware prediction of OS run-length for fine-grained resource customization., , , und . ISPASS, Seite 111-112. IEEE Computer Society, (2010)Beyond the socket: NUMA-aware GPUs., , , , , , , und . MICRO, Seite 123-135. ACM, (2017)