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PaDReH: a framework for the design and implementation of dynamically and partially reconfigurable systems., , , und . SBCCI, Seite 10-15. ACM, (2004)Router architecture for high-performance NoCs., , und . SBCCI, Seite 111-116. ACM, (2007)Triple Rail Logic Robustness against DPA., , , , , , und . ReConFig, Seite 415-420. IEEE Computer Society, (2008)A monitored NoC with runtime path adaptation., , , , und . ISCAS, Seite 1965-1968. IEEE, (2014)QoS in Networks-on-Chip - Beyond Priority and Circuit Switching Techniques., , und . VLSI-SoC (Selected Papers), Volume 291 von IFIP, Seite 1-22. Springer, (2007)H2A: A hardened asynchronous network on chip., , und . SBCCI, Seite 1-6. IEEE, (2013)Parity check for m-of-n delay insensitive codes., , und . IOLTS, Seite 157-162. IEEE, (2013)Lasio 3D NoC vertical links serialization: Evaluation of latency and buffer occupancy., , , , , und . SBCCI, Seite 1-6. IEEE, (2013)SPP-NIDS - A Sea of Processors Platform for Network Intrusion Detection Systems., , , , und . IEEE International Workshop on Rapid System Prototyping, Seite 27-33. IEEE Computer Society, (2007)Evaluation of current QoS Mechanisms in Networks on Chip., , , und . SoC, Seite 1-4. IEEE, (2006)