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False-Noise Analysis using Logic Implications., , , , , und . ICCAD, Seite 515-. IEEE Computer Society, (2001)Transistor reordering for low power CMOS gates using an SP-BDD representation., , und . ISLPD, Seite 161-166. ACM, (1995)Calculation of stress probability for NBTI-aware timing analysis., , und . ISQED, Seite 714-718. IEEE Computer Society, (2009)False-Noise Analysis Using Resolution Method., , , , , und . ISQED, Seite 437-442. IEEE Computer Society, (2002)Fast power loss calculation for digital static CMOS circuits., , , , , und . ED&TC, Seite 411-415. IEEE Computer Society, (1997)Library-less synthesis for static CMOS combinational logic circuits., , , , , , , und . ICCAD, Seite 658-662. IEEE Computer Society / ACM, (1997)False-Noise Analysis for Domino Circuits., , , , , und . DATE, Seite 784-789. IEEE Computer Society, (2004)SOI Transistor Model for Fast Transient Simulation., , , , , , , , , und . ICCAD, Seite 120128. IEEE Computer Society / ACM, (2003)Delay noise pessimism reduction by logic correlations., , , , , , und . ICCAD, Seite 160-167. IEEE Computer Society / ACM, (2004)