Autor der Publikation

Reducing Cross-Talk Induced Power Consumption and Delay.

, , und . PATMOS, Volume 3254 von Lecture Notes in Computer Science, Seite 179-188. Springer, (2004)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Technology exploration for adaptive power and frequency scaling in 90nm CMOS., , und . ISLPED, Seite 14-19. ACM, (2004)Reducing Cross-Talk Induced Power Consumption and Delay., , und . PATMOS, Volume 3254 von Lecture Notes in Computer Science, Seite 179-188. Springer, (2004)Body bias driven design synthesis for optimum performance per area., und . ISQED, Seite 472-477. IEEE, (2010)CMDS: Cross-layer Dataflow Optimization for DNN Accelerators Exploiting Multi-bank Memories., , , , , , und . ISQED, Seite 1-8. IEEE, (2023)Analysis of the Influence of Substrate on the Performance of On-Chip MOS Decoupling Capacitors., und . IEEE J. Solid State Circuits, 44 (2): 484-494 (2009)An Activity Monitor for Power/Performance Tuning of CMOS Digital Circuits., , und . PATMOS, Volume 3728 von Lecture Notes in Computer Science, Seite 187-196. Springer, (2005)Active Noise Cancellation Using Aggressor-Aware Clamping Circuit for Robust On-Chip Communication., , und . VLSI Design, Seite 325-329. IEEE Computer Society, (2005)CMDS: Cross-layer Dataflow Optimization for DNN Accelerators Exploiting Multi-bank Memories., , , , , , und . CoRR, (2024)Glitch-free discretely programmable clock generation on chip., , und . ISCAS (2), Seite 1839-1842. IEEE, (2005)A forward body bias generator for digital CMOS circuits with supply voltage scaling., , , , , , und . ISCAS, Seite 2482-2485. IEEE, (2010)