Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Self-Healing Many-Core Architecture: Analysis and Evaluation., und . VLSI Design, (2016)On-Chip Verification of NoCs Using Assertion Processors., , , , und . DSD, Seite 535-538. IEEE Computer Society, (2007)An off-line MDSI interconnect BIST incorporated in BS 1149.1., , , und . ETS, Seite 1-2. IEEE, (2014)SCOAP-based Directed Random Test Generation for Combinational Circuits., , , und . EWDTS, Seite 1-5. IEEE, (2019)An Accelerator-based Architecture Utilizing an Efficient Memory Link for Modern Computational Requirements., , , , , , und . EWDTS, Seite 1-6. IEEE, (2019)Modeling Timing Behavior of Logic Circuits Using Piecewise Linear Models., , , und . CHDL, Volume A-32 von IFIP Transactions, Seite 569-586. North-Holland, (1993)Using Verilog VPI for Mixed Level Serial Fault Simulation in a Test Generation Environment., , und . Embedded Systems and Applications, Seite 139-143. CSREA Press, (2003)A Low Power BIST Architecture for FPGA Look-Up Table Testing., und . VLSI-SOC, Seite 394-397. Technische Universität Darmstadt, Insitute of Microelectronic Systems, (2003)Digital design and implementation with field programmable devices.. Kluwer, (2005)HDLs evolve as they affect design methodology for a higher abstraction and a better integration.. DTIS, Seite 1. IEEE, (2015)