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Performance modeling of embedded applications with zero architectural knowledge., und . CODES+ISSS, Seite 277-286. ACM, (2010)Towards On-Chip Learning for Low Latency Reasoning with End-to-End Synthesis., , , , , , , , , und . ASP-DAC, Seite 632-638. ACM, (2023)Parametric Throughput Oriented Large Integer Multipliers for High Level Synthesis., , , und . DATE, Seite 38-41. IEEE, (2021)Fitness inheritance in evolutionary and multi-objective high-level synthesis., , , , , und . IEEE Congress on Evolutionary Computation, Seite 3459-3466. IEEE, (2007)High-Level Synthesis of Parallel Specifications Coupling Static and Dynamic Controllers., , und . IPDPS, Seite 192-202. IEEE, (2021)SYNAPTIC Project: Regularity Applied to Enhance Manufacturability and Yield at Several Abstraction Levels., , , , , , , , , und 3 andere Autor(en). ARCS Workshops, VDE-Verlag, (2011)Reduction of Fault Detection Costs through Testable Design of Sequential Architectures with Signal Feedbacks., , , , , und . DFT, Seite 223-230. IEEE Computer Society, (1993)Trace-based automated logical debugging for high-level synthesis generated circuits., , und . ICCD, Seite 251-258. IEEE Computer Society, (2015)An Application of Genetic Algorithms and BDDs to Functional Testing., , , und . ICCD, Seite 48-56. IEEE Computer Society, (2000)Function Proxies for Improved Resource Sharing in High Level Synthesis., , , und . FCCM, Seite 100. IEEE Computer Society, (2015)