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Exploring the problems of placement and mapping in NoC-based reconfizurable systems., und . ReConFig, Seite 1-4. IEEE, (2013)Collective Test Generation and Test Set Compaction., und . ISCAS, Seite 2008-2011. IEEE, (1995)Mixed signal verification to avoid integration mismatch in complex SoCs., , und . LATS, Seite 1-6. IEEE, (2017)Functional verification of complete sequential behaviors: A formal treatment of discrepancies between system-level and RTL descriptions., , und . IDT, Seite 1-6. IEEE, (2013)DyAFNoC: Dynamically Reconfigurable NoC Characterization Using a Simple Adaptive Deadlock-Free Routing Algorithm with a Low Implementation Cost., , , und . ARC, Volume 9040 von Lecture Notes in Computer Science, Seite 419-426. Springer, (2015)BIST Plan Optimization and Independent Input Test Register Insertion for Datapath Functional Units., , , und . LATW, Seite 64-69. IEEE, (2002)Formally verifying an RTOS scheduling monitor IP core in embedded systems., , , und . LATW, Seite 1-6. IEEE, (2011)The LRD traffic impact on the NoC-based SoCs., , , und . SBCCI, Seite 97-102. ACM, (2010)Intra-chip traffic generation under autoregressive models based on time series obtained by TLM simulation., , und . SoCC, Seite 41-46. IEEE, (2016)On TLM traffic accuracy: A multifractal perspective., und . LASCAS, Seite 1-4. IEEE, (2018)