Autor der Publikation

The Importance of Prepass Code Scheduling for Superscalar and Superpipelined Processors.

, , , , und . IEEE Trans. Computers, 44 (3): 353-370 (1995)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Tolerating First Level Memory Access Latency in High-Performance Systems., , und . ICPP (1), Seite 36-43. CRC Press, (1992)The Effect of Compiler Optimizations on Available Parallelism in Scalar Programs., , , , und . ICPP (2), Seite 142-145. CRC Press, (1991)Embracing heterogeneity with dynamic core boosting., und . Conf. Computing Frontiers, Seite 10:1-10:10. ACM, (2014)Sentinel Scheduling for VLIW and Superscalar Processors., , , , , , und . ACM Trans. Comput. Syst., 11 (4): 376-408 (1993)preliminary version: ASPLOS 1992: 238-247.Increasing hardware efficiency with multifunction loop accelerators., , , und . CODES+ISSS, Seite 276-281. ACM, (2006)Cost-efficient soft error protection for embedded microprocessors., , , und . CASES, Seite 421-431. ACM, (2006)Scalable subgraph mapping for acyclic computation accelerators., , , und . CASES, Seite 147-157. ACM, (2006)StageNet: A Reconfigurable Fabric for Constructing Dependable CMPs., , , und . IEEE Trans. Computers, 60 (1): 5-19 (2011)Uncovering hidden loop level parallelism in sequential applications., , , und . HPCA, Seite 290-301. IEEE Computer Society, (2008)Gadara: Dynamic Deadlock Avoidance for Multithreaded Programs., , , , und . OSDI, Seite 281-294. USENIX Association, (2008)