Autor der Publikation

System-level power consumption modeling and tradeoff analysis techniques for superscalar processor design.

, , , und . IEEE Trans. Very Large Scale Integr. Syst., 8 (2): 129-137 (2000)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Binary translation and architecture convergence issues for IBM system/390., , , und . ICS, Seite 336-347. ACM, (2000)Instruction Fetch Mechanisms for VLIW Architectures with Compressed Encodings., , , , und . MICRO, Seite 201-211. ACM/IEEE Computer Society, (1996)System-level power consumption modeling and tradeoff analysis techniques for superscalar processor design., , , und . IEEE Trans. Very Large Scale Integr. Syst., 8 (2): 129-137 (2000)A Fast Interrupt Handling Scheme for VLIW Processors., , , , , und . IEEE PACT, Seite 136-141. IEEE Computer Society, (1998)Dynamic Binary Translation and Optimization., , , und . IEEE Trans. Computers, 50 (6): 529-548 (2001)Path Prediction for High Issue-Rate Processors., , und . IEEE PACT, Seite 178-188. IEEE Computer Society, (1997)Preface., und . IBM J. Res. Dev., 50 (2-3): 169-171 (2006)MPS: Miss-Path Scheduling for Multiple-Issue Processors., , , und . IEEE Trans. Computers, 47 (12): 1382-1397 (1998)Dynamic rescheduling: a technique for object code compatibility in VLIW architectures., und . MICRO, Seite 208-218. ACM / IEEE Computer Society, (1995)A Persistent Rescheduled-page Cache for Low Overhead Object Code Compatibility in VLIW Architectures., , und . MICRO, Seite 4-13. ACM/IEEE Computer Society, (1996)