Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

12.3 A low-power and high-performance 10nm SRAM architecture for mobile applications., , , , , , , , , und 4 andere Autor(en). ISSCC, Seite 210-211. IEEE, (2017)A 500MHz Random-Access Embedded 1Mb DRAM Macro in Bulk CMOS., , , , , , , , , und 1 andere Autor(en). ISSCC, Seite 270-271. IEEE, (2008)Isodelay output driver design using step-wise charging for low power., und . ESSCIRC, Seite 149-152. IEEE, (2005)Aggressor aware repeater circuits for improving on-chip bus performance and robustness., , und . ESSCIRC, Seite 261-264. IEEE, (2003)High speed current-mode signaling circuits for on-chip interconnects., , und . ISCAS (4), Seite 4138-4141. IEEE, (2005)New ECC for Crosstalk Impact Minimization., , , und . IEEE Des. Test Comput., 22 (4): 340-348 (2005)Impact of ECCs on Simultaneously Switching Output Noise for On-Chip Busses of High Reliability Systems., , , , und . IOLTS, Seite 135-140. IEEE Computer Society, (2004)Reducing Cross-Talk Induced Power Consumption and Delay., , und . PATMOS, Volume 3254 von Lecture Notes in Computer Science, Seite 179-188. Springer, (2004)Adaptive threshold scheme to operate long on-chip buses at the limit of signal integrity., , , und . ESSCIRC, Seite 323-326. IEEE, (2004)A 3nm 256Mb SRAM in FinFET Technology with New Array Banking Architecture and Write-Assist Circuitry Scheme for High-Density and Low-VMIN Applications., , , , , , , , , und 8 andere Autor(en). VLSI Technology and Circuits, Seite 1-2. IEEE, (2023)